[理工] 计组 pipeline AdonisLam PTT批踢踢实业坊

[理工] 计组 pipeline

楼主: AdonisLam (Adonis) 2019-11-29 16:49:33

如附图
第一题的cycle time是那些元件的时间
http://i.imgur.com/6U51xzF.jpg
http://i.imgur.com/707p05A.jpg

作者: zuchang (chang) 2019-11-29 17:02:00

所以你的问题是什么 = =

楼主: AdonisLam (Adonis) 2019-11-29 23:46:00

我是问他写的时间是哪些元件的延迟时间因为他只有写数字

作者: zuchang (chang) 2019-11-30 13:04:00

IF:15+50(pc+memID:15+20+10(control+muxEXE:15+20+10+30(mux+alu+forwardingMEM:15+50WB:15+10+20 除了IF之外都要加上pipeline register

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