[交大100 计组非选4(a)]
Assume that logic blocks needed to implement the datapath have the following
latencies: (Delays for other components are ignored. )
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I-Mem Add Mux ALU Regs D-Mem Sign-Ext shift-left2
__________________________________________________________
400 100 40 120 200 350 20 10
Compute the required delay time for each instruction and determine the minimum
cycle time of the computer.
资料路径图

参考高铭100年考古题解答
Q1:
lw = 400+200+(40+120)+350+(40+200)=1350
想问ID stage 不用加上Sign-Ext的延迟是因为线路同时跑 Reg File 和 Sign-Ext ,
因为前者时间长所以不用考虑后者 ?
Q1-1:
如果是的话 , 同理 , 在beq的 EX stage也有相同状况 ?
beq = 400+200+40+120+40 = 800
(sll 2 和 分支位址加法)与(ALUSrc 和 ALU)同时跑取延迟大者 ?
[交大100 计组非选5(a)]
题目截图

1 lw $t2,4($t0) 为啥一样是load use , I1,I3有data hazard
2 lw $t3,4($t1) 可是 I2,I4没有 ?
3 or $t3,$t2,$t3
4 add $t4,$t2,$t3
.
. 以下略
.
谢谢大家看完 , 再请大家指导惹

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