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[请益] Verilog 转schematic 电路 的软件

楼主: iwillfight (gogo)   2016-06-23 21:20:30
Dear 大哥
请问 若有 verilog 档 , 想要转成电路图
请问该使用那种软件转 最方便？
thanks
作者: HardyJJ (JJHardy)   2016-06-23 21:32:00
写信嘛？发错地方？
作者: kuliao (太残酷了)   2016-06-23 21:34:00
fpga软件都有?
作者: kclvpc (kclvpc)   2016-06-23 21:41:00
合成软件不知道名字吗...
作者: rogergon ( Aquila)   2016-06-23 21:49:00
自己写啊！XD
作者: saes2005 (saes2005)   2016-06-23 22:23:00
Design Compiler
作者: wan8088 (大屁屁怪獸)   2016-06-23 22:28:00
Ise ?
作者: centra (ukyo)   2016-06-23 22:33:00
自己写难度太高了那DC也不用卖那么贵了
作者: StrKO (Trip.)   2016-06-23 22:36:00
ISE吧 要合完才看得到gate level只是ISE很大包 要载要灌都蛮花时间的XD
作者: dakkk (我是牛我反刍)   2016-06-23 22:42:00
数位转成电路 大概就是一堆flipflop 看有何意义？
作者: StrKO (Trip.)   2016-06-23 22:48:00
作报告吧
作者: tokyoboy (日本男孩)   2016-06-23 22:59:00
regards 去哪了
作者: xanter (南宫恨)   2016-06-23 23:10:00
quartus有RTL VIEW可以看，不过这边不是给你问这个的
作者: timandtony   2016-06-23 23:36:00
quartus可以转
作者: tkhan (脑残绿吱吱)   2016-06-24 08:33:00
word不错用..
作者: tomet (沁)   2016-06-24 12:59:00
两家fpga的软件 quartus or vivado 选一个呗
作者: BangDoll320 (想念)   2016-06-24 13:36:00
怎么会推荐用 FPGA tool？转出来都是 LUT，多难看
作者: nova06091   2016-06-24 15:08:00
小画家
作者: book7 (...)   2016-06-25 09:44:00
转成线路图会更看不懂 学verilog还实际点
作者: muimio (miu)   2016-06-25 14:17:00
cadence就有了耶 不过要std cell sch
作者: yytseng (yytseng)   2016-06-26 13:25:00
schematic ? 用verdi
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