PTT
Submit
Submit
选择语言
正體中文
简体中文
PTT
ICDESIGN
[讨论] CIC芯片良率
楼主:
magicrr
(很困)
2008-10-14 16:48:47
※ [本文转录自 comm_and_RF 看板]
作者: magicrr (信义区吉屋出租) 看板: comm_and_RF
标题: [讨论] CIC芯片良率
时间: Tue Oct 14 16:47:39 2008
想请问一下大家请CIC下线芯片回来的结果大部分都如何呢??
我们实验室学长花了一堆心力结果量不出来
很肯定电路是没有问题的但是做回来却坏了
现在正在那边槌心肝
想请问大家的经验如何呢
作者:
pinns
(风城之心)
0000-00-00 00:00:00
那当然是LAYOUT出了问题比较大...怪CIC的良率基本上很不明智.先看LAYOUT方面着手吧.如果做高频的电路 那更有可能了,业界很多都败在LAYOUT.何况是 研究用学生做的论文.= =怀疑cic就怀疑tsmc吧.都在那边下.
作者: moneyguy (想认识我请告诉我~)
0000-00-00 00:00:00
先看是什么制程吧~不过,连TSMC都要怀疑了,出去混怎么办
作者:
Baghdad
(真的好想念)
0000-00-00 00:00:00
CIC很稳的.我们以前几乎都是自己问题.若是RF考虑要很多
作者: swwhung (容光焕发...^^)
0000-00-00 00:00:00
稳定~~都在corner附近
继续阅读
[闲聊] qimonda被出售了!
dylanoo
[情报] 12吋晶圆占全球晶圆产能最大宗
alonepier
[问题] 芯片中的滤波电路一般应该怎么做?
dylanoo
[售书] 大降价 Fundamentals of Logic Design
bryan7172
[请益] 校园活动
chaow
[问题] 征求电子好手
buunsou
[问题] 如何用hspice RF模拟vco的相位噪声
abcjefgh
[公告]征IC测试认证兼职人员(竹北)
mark66
Re: [问题]如何用hspice模拟相位噪声?
abcjefgh
[问题]如何用hspice模拟相位噪声?
abcjefgh
Links
booklink
Contact Us: admin [ a t ] ucptt.com