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CSIE_R202
[DCL ] 实验六的正反器Simulation
楼主:
LogicLab
(202TA)
2009-11-05 16:45:44
关于实验六的第一部分
原本要求同学实作一个JK Flip-Flop并跑Simulation
现在多要求同学加入Clear及Preset的功能
相关电路图已经更新在实验六的投影片上
多加这两条线是为了能初始化 Flip-Flop 上 Q 的值
如果没有先初始化的话
Simulation会无法跑出正确的结果
(因为在JK Flip-Flop中, Q会被当成input输入)
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